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El SoC Kirin 9050 Pro de Huawei usa dos dies en vertical para reducir su tamaño y duplicar la densidad respecto al Kirin 9030
Huawei presenta el SoC Kirin 9050 Pro, que utiliza dos dies en vertical para reducir su tamaño y duplicar la densidad frente al Kirin 9030.
Huawei fue muy conocida en los inicios de la era Android debido a que vendía móviles chinos con gran relación coste/rendimiento. Su negocio casi acabó cuando EE.UU. la puso en la lista negra de empresas y tuvieron que centrarse en el comercio en China. A pesar de ello, Huawei regresó mucho más fuerte que nunca y a día de hoy, se encarga de crear móviles, chips y mucho más trabajando con fabricantes como SMIC. La última creación de Huawei y SMIC es el SoC Kirin 9050 Pro, el cual sorprende, ya que tiene dos dies verticales que le permiten optimizar su tamaño y densidad.
Huawei avanza a pasos agigantados en el mundo de los semiconductores y en cuanto a móviles está teniendo bastante éxito. Esto es algo curioso, pues sus móviles no son especialmente baratos, más bien lo contrario, pues tienen precios de iPhone de Apple, pero a su vez no tienen su potencia. Esto se debe a que los chips de Huawei están bastante por detrás de los de Apple, Qualcomm, MediaTek e incluso Samsung.
El SoC Huawei 9050 Pro usa 2 dies en vertical y logra una densidad de más del doble que el Kirin 9030
A pesar de que los SoC de Huawei no son muy potentes comparado al resto de la gama alta de chips, la compañía ha demostrado que es capaz de mejorar y avanzar superando las expectativas en ellos. Hace apenas un año teníamos un Kirin 9030 que usaba el nodo N+3 (5 nm) y ahora se habla del Huawei 9050 Pro como un nuevo SoC que duplica la densidad del anterior. Esto lo consigue debido a que el Kirin 9050 Pro usa dos dies verticales en lugar de depender solo de un nodo más avanzado.
Con esto consigue una densidad planar de 238 millones de transistores/mm², un poco más del doble de los 112 millones/mm² del Kirin 9030. Los filtradores mencionaron que el die de cómputo está fabricado con el proceso N+3 de SMIC y el die de SRAM usa el N+2.
El Kirin 9050 Pro tiene un tamaño incluso más pequeño que el Kirin 9030S
El Kirin 9050 Pro utiliza una tecnología denominada LogicFolding, que une verticalmente dos piezas de silicio: un die de lógica/cómputo y otro dedicado principalmente a SRAM y caché. Ambos tienen exactamente el mismo tamaño, 11,13 × 10,84 mm, con un área de 120,65 mm² cada uno. Con este tamaño sería incluso ligeramente más pequeño que los aproximadamente 122 mm² del Kirin 9030S, pese a incorporar una arquitectura mucho más avanzada.
El objetivo es aumentar considerablemente la cantidad efectiva de circuitería dentro de una superficie reducida. Al colocar la memoria encima o debajo de la lógica, Huawei puede evitar que grandes bloques de SRAM ocupen espacio en el mismo plano que CPU, GPU y otros componentes. La ventaja se limita solo a ahorrar espacio, pues las conexiones verticales extremadamente cortas entre ambos dies permiten mover datos entre lógica y caché con recorridos más pequeños que en un diseño convencional.
En teoría, esto puede mejorar latencia, ancho de banda y consumo energético, haciendo que las dos capas funcionen de manera parecida a un único chip integrado. En la prueba de rendimiento de este chip tenemos una mejora ligera sobre el Tensor G6 en Geekbench CPU mientras que en 3DMark Steel Nomad Light se observa una mejora considerable, pasando de unos 1200 del G6 a unos 1.400 puntos.
Fuentes:
https://elchapuzasinformatico.com/2026/10/huawei-kirin-9050-pro-dies-verticales/

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